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[Sammelthread] Intel DDR5 RAM OC Thread
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Wer sein Glück günstig mit dem Gigabyte B760i versuchen möchte:
- Topcashback gibt aktuell 6% Cashback, auch auf gebrauchte Artikel
- Gigabyte Cashback (20€) gibt es auch auf gebrauchte Artikel, habe nachgefragt:
D.h. effektiv für ~130€ zu haben
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Hahaha
You came far
Mm mm
Good morning~
I look forward to the day you remove those 60mV IA voltage cut, and start to use IA/DC loadline correction
It might be memory related at this point (they jump too much in voltage up & down), but i still thinks its user error and you should not use vcore offsets~~
Maaan
Don't tell me you did test voltage after voltage
Where is VST+VT3
If you touch only SA, you need correction on the rest
Only VDDQ is kind of an own thing.
But it still will be influenced by SA position
Its interesting that you can run 230mV delta between VDDQ's
But zebra is only at 140mV
You need to test longer and not test isolated.
VT3 alone is not the same effect as both together.
If you change SA, you need to change the rest
You ask a lot of questions
Please do some work yourself first.
With spoonfeeding you will not learn
If you want to learn, read last pages
Goes for everything, but some questions are answered ~ like tWR on page 412
Best suggestion to give:
Dont fixate vcore.
You will slowly kill your cpu that way.
Even faster with y-cruncher VST+VT3, which you have to run !
On weaker loads you waste boosting potential
Only losses, dont fixate vcore or clock.
zebra_hun
Profi
I left the offsets as we discussed.
From Global SVID, Cache, and L2.
I did it now in the V/F points.
IA AC DC LL (AC0.1 DC 0.82) could have caused me a problem. Now AC DC LL both auto. Just V/F.
I never give a fixed Vcore, nor do I fix a frequency.
This was a one-time test of Power Plan maximum performance.
Sorry, I can show results slowly, I go to work at 5 in the morning and 7 in the evening when I get home.
I meant not to use Global SVID, but V/F is a good solution.
There is one more thing that is strange to me. I progressed with the ram oc in small steps, and the PC runs very stably up to 7200mhz.
The VST/VT3 works very easily up to 56xP 45xE 49xR frequency.
MC voltage is also incredibly low.
7200 20 min long, it's nothing i know, but run fine.
If I have meaningful results, I will report here.
Thanks
From Global SVID, Cache, and L2.
I did it now in the V/F points.
IA AC DC LL (AC0.1 DC 0.82) could have caused me a problem. Now AC DC LL both auto. Just V/F.
I never give a fixed Vcore, nor do I fix a frequency.
This was a one-time test of Power Plan maximum performance.
Sorry, I can show results slowly, I go to work at 5 in the morning and 7 in the evening when I get home.
I meant not to use Global SVID, but V/F is a good solution.
There is one more thing that is strange to me. I progressed with the ram oc in small steps, and the PC runs very stably up to 7200mhz.
The VST/VT3 works very easily up to 56xP 45xE 49xR frequency.
MC voltage is also incredibly low.
7200 20 min long, it's nothing i know, but run fine.
If I have meaningful results, I will report here.
Thanks
I write from the phone, and didnt send it yesterday
The screenshot sadly was removed on my side.
It says offsets -0.06
And IA supply can be either ring or vcore.
V/F curve is difficult, very
You need to check and build it with tool.exe
Because 13/14th gen has not single v/f point unlike 12th gen
You do correct telemetry with LLC
Cpu recognizes your changes and adapts what it requests.
Based on this you then slowly modify v/f points
But v/f points have an adapted condition.
The highest point of the curve is the anchor point.
Its not as easy to say point 13 +50mV = only peak +50
It will shift it based on that, but it will also shift ring curve and then shift "loaded" points.
Loaded points in the sense of loadbalancing and then in the sense of effective clock strap.
This means that each clock point in the curve is calculated from the early curve points and next curve points shift
You cant just make a spike in the curve and think the rest stays the same. You don't know from what you shift how much. You cant shift one point only.
I will try to explain another day.
OCN has early testers who worked with this.
Roberto and some other people. Maybe you can figure it out from there.
Ah right,
Because all is in a loaded condition, if headroom is little then it will not hold those v/f points
So also ring will not boost and so on.
Its too complicated to explain without examples
But ASUS Tool.exe has all you need to track this behavior.
Track speed in y-cruncher
This will show IOPS loss even if clock strap is held.
#Loadbalanced, virtual clock numbers are irrelevant
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G.Skill DIMM 48 GB DDR5-8400 (2x 24 GB) Dual-Kit, Arbeitsspeicher weiß, F5-8400J4052G24GX2-TZ5RW, Trident Z5 RGB, INTEL XMP
Das G.Skill F5-8400J4052G24GX2-TZ5RW ist ein Kit aus 2x 24 GB DDR5-8400 (PC5-67200) Speichermodulen aus der Trident Z5 RGB Serie. Das 288-Pin Modul...
www.alternate.de
8400 weiß auf Lager.
CUSTOM1337
Profi
I read a lot last 2 weeks thats by far my best atm. What do you mean with Fixate?Hahaha
You came far
Mm mm
Good morning~
I look forward to the day you remove those 60mV IA voltage cut, and start to use IA/DC loadline correction
It might be memory related at this point (they jump too much in voltage up & down), but i still thinks its user error and you should not use vcore offsets~~
Maaan
Don't tell me you did test voltage after voltage
Where is VST+VT3
If you touch only SA, you need correction on the rest
Only VDDQ is kind of an own thing.
But it still will be influenced by SA position
Its interesting that you can run 230mV delta between VDDQ's
But zebra is only at 140mV
You need to test longer and not test isolated.
VT3 alone is not the same effect as both together.
If you change SA, you need to change the rest
You ask a lot of questions
Please do some work yourself first.
With spoonfeeding you will not learn
If you want to learn, read last pages
Goes for everything, but some questions are answered ~ like tWR on page 412
Best suggestion to give:
Dont fixate vcore.
You will slowly kill your cpu that way.
Even faster with y-cruncher VST+VT3, which you have to run !
On weaker loads you waste boosting potential
Only losses, dont fixate vcore or clock.
I use LLC5/ VRM Core Voltage Adaptive in Bios -0.06500 and my All core P is 5,3 + Cache 4,7 and my E Cores are 4,2. What do you mean with killing, fixate? 13700k CPU
Fixiere (fixate) keine Kern Spannungen ! Du schadest deiner CPU da diese auf X gegebene last sich kaum anpassen kann.
Die CPUs können "voltage & clock gating". Somit haben Spannungen & Frequenzen dynamisch zu sein.
Diese haben ebenso Guardbands,
Guardbands simplified:
Marginal acceptance of X specific strain, with calculated up and down margins.
Be it with Thermals as anchors , FIT (rate of allowable errors in Y time), or with similar lookup base of CPUs current and variable health
^ Credits Keysight-Technologies
Guardbands technical term:
https://ces.itec.kit.edu/img/Aging_Aware_Voltage_Scaling.pdf Raw Technical
https://sci-hub.ru/10.1109/EPEPS.2018.8534272 Visual Technical and easier to understand
BestRegard ~ Intel™Used in everything from GPUs to CPUs, to PCB design and house design (last two in aberrative/modified design form)
Benütze kein faking von dem PWM controller.
Die CPUs sind Intelligent und beobachten was sie bekommen bzw was sie Anfordern.
Du erstellst absichtlich eine Infinite-Request situation, da nie das ankommt was ankommen soll.
Somit wird immer mehr und mehr angefordert mit dem Resultat dass Throttling passieren wird, da die "virtuelle" Last zu hoch sein wird.
Einfach da die CPU deutlich mehr anzufordern hat, um die Nutzerfehler zu korrigieren.
Für die CPU sieht das wie ein billiges Mainboard aus,, dass bei dem Transport der Spannung (sagen wir mal 50mV) ein großes Stückchen verliert.
Für die CPU ist es nicht unterscheidbar zwischen einem 100$ Mainboard mit ungenauen und ineffizienten Spannungswandlern
Das fixieren der Frequenz, hat den selben Effekt.
Clock gating ist eine Sache und es ist unmöglich für die CPU sich bei X bestimmter Last zu throttlen und sich selbst zu schützen.
Du schadest ihr , im Austausch konstantem hohem Stromverbrauch und 50-100MHz mehr über den von echten Engineer's anerkannten silicon Limits.
Die CPU kann sich selbst schützen. Bitte renne keine fixierte Spannung oder fixierte Frequenz.
Einiges an Sicherungen sind weiterhin aktiv, aber "fixed-clock" ist eine 2010-2012 Sache.
Es ist sehr schädigend für die CPU wenn du ein Teil derren Sicherheitsfunktionen durch ... ehrlich gesagt Blödsinn , überspringst.
Ein weiterer Nachteil ist verschenkter Boost bei Situationen welche sie gebraucht werden. Low-Amperage load bzw Spiele.
Arbeite mit dem Boosting System
Nicht dagegen.
Beitrag automatisch zusammengeführt:
@zebra_hun
^ 12th gen example & Z690 Apex.
Each harsh curve point you see is an own curve part. A step.
Influences points before and after itself.
Post unsubmitted.
Was work for an "ASUS ?" supported OCer and to educate OCN.
Shows work procedure and discussion-point ~ was low priority kept research for myself.
Topic is huge and too long to explain now.
You test CPU Stability with Y-cruncher SFT & VT3 is a good mixed load.
Same torture targets ~ around 90minutes as absolute minimum.
Run ICCMAX limiters (no need for PT1/2 with water) or you harm your CPU for such torture tests~
Sorry for the Spam
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Very !
Gigabyte B760M A ELITE X AX ~ 210€ (Cashback unbekannt)
https://www.overclock.net/threads/o...bility-thread.1794772/page-1101#post-29278579 ~ 8000MT/s.
Mit godbin 8400 bootable. Ich wette mit etwas Hilfe schafft er 8600
Billig und ganz solide. Da auf der verbesserter Topology. (X-Refresh Lineup)
Das ITX braucht einen refresh ohne Silk über memtraces.
Es ist schade, den bei dem Tachyon (X) weiß man das. Würde den Verkauf davon warscheinlich schaden.
~ 300 (-40€ Cashback)
95% Vorbildlich ~ PCB layer unbekannt, 6 oder 8
Bzw (~410€ -50€)
https://geizhals.de/gigabyte-z790-aorus-pro-x-a3020567.html
MSI MPG Z790I Edge WIFI ~ 370€ , 280-300 Ebay
Fast vorbildlich
Vorbildlich:
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immerhin ein kleiner Erfolg. Nachdem ich auf das offizielle BIOS 0801 aktualisiert hatte (hatte vorher die 0080 Beta, was eigentlich gleich sein sollte) habe ich nochmals von 0 angefangen. Im Prinzip alles auf Auto gelassen, nur SA auf 1.21. (TX 1.35, MC 1.385, VDD/VDDQ 1.4) Und siehe da, es läuft. Auch wenn y-cruncher noch nach ca. 60 Minuten einen Fehler gebracht hat (leider vergessen einen Screenshot zu machen). Von daher traue ich der Sache noch nicht so ganz . Aber immerhin ist TM5 90 Min und Karhu 10000% gelaufen.
Wirklich verstehen tue ich es trotzdem nicht... könnte fast wetten, dass, wenn ich es nochmals mit den selben Settings laufen lasse, wieder fehler kommen....
. Aber immerhin ist TM5 90 Min und Karhu 10000% gelaufen.Wirklich verstehen tue ich es trotzdem nicht... könnte fast wetten, dass, wenn ich es nochmals mit den selben Settings laufen lasse, wieder fehler kommen....
Anhänge
zebra_hun
Profi
Hi Veii!
First, tried my 24/7 7200 profil.
Everything for cpu are auto.
Core Usage 1-8 = 55
AC LL 0.6 (if i right remember)
My 7200 profil is the best voltages, stabilitat, quick, and gives super low fps in games (TR 406AVG, 298MIN)
6h 25 min, and i share BIOS later, but i go back to sleep. I've got 2h now back before i go to work
Thx your inputs
First, tried my 24/7 7200 profil.
Everything for cpu are auto.
Core Usage 1-8 = 55
AC LL 0.6 (if i right remember)
My 7200 profil is the best voltages, stabilitat, quick, and gives super low fps in games (TR 406AVG, 298MIN)
6h 25 min, and i share BIOS later, but i go back to sleep. I've got 2h now back before i go to work
Thx your inputs
[2023/12/30 04:56:14]
Ai Overclock Tuner [Auto]
Intel(R) Adaptive Boost Technology [Auto]
ASUS MultiCore Enhancement [Auto – Lets BIOS Optimize]
SVID Behavior [Auto]
BCLK Frequency : DRAM Frequency Ratio [100:100]
Memory Controller : DRAM Frequency Ratio [1:2]
DRAM Frequency [DDR5-7200MHz]
Performance Core Ratio [By Core Usage]
1-Core Ratio Limit [55]
2-Core Ratio Limit [55]
3-Core Ratio Limit [55]
4-Core Ratio Limit [55]
5-Core Ratio Limit [55]
6-Core Ratio Limit [55]
7-Core Ratio Limit [55]
8-Core Ratio Limit [55]
Performance Core0 Specific Ratio Limit [Auto]
Performance Core0 specific Voltage [Auto]
Performance Core1 Specific Ratio Limit [Auto]
Performance Core1 specific Voltage [Auto]
*Performance Core2 Specific Ratio Limit [Auto]
Performance Core2 specific Voltage [Auto]
*Performance Core3 Specific Ratio Limit [Auto]
Performance Core3 specific Voltage [Auto]
Performance Core4 Specific Ratio Limit [Auto]
Performance Core4 specific Voltage [Auto]
Performance Core5 Specific Ratio Limit [Auto]
Performance Core5 specific Voltage [Auto]
Performance Core6 Specific Ratio Limit [Auto]
Performance Core6 specific Voltage [Auto]
Performance Core7 Specific Ratio Limit [Auto]
Performance Core7 specific Voltage [Auto]
Efficient Core Ratio [By Core Usage]
Efficient Turbo Ratio Limit 1 [Auto]
Efficient Turbo Ratio Cores 1 [Auto]
Efficient Core Group0 Specific Ratio Limit [Auto]
Efficient Core Group0 specific Voltage [Auto]
Efficient Core Group1 Specific Ratio Limit [Auto]
Efficient Core Group1 specific Voltage [Auto]
Efficient Core Group2 Specific Ratio Limit [Auto]
Efficient Core Group2 specific Voltage [Auto]
Efficient Core Group3 Specific Ratio Limit [Auto]
Efficient Core Group3 specific Voltage [Auto]
AVX2 [Enabled]
AVX2 Ratio Offset to per-core Ratio Limit [User Specify]
AVX2 Ratio Offset [0]
AVX2 Voltage Guardband Scale Factor [User Specify]
AVX2 Voltage Guardband Scale Factor [0]
Maximus Tweak [Mode 2]
DRAM CAS# Latency [32]
DRAM RAS# to CAS# Delay Read [42]
DRAM RAS# to CAS# Delay Write [16]
DRAM RAS# PRE Time [42]
DRAM RAS# ACT Time [54]
DRAM Command Rate [2N]
DRAM RAS# to RAS# Delay L [12]
DRAM RAS# to RAS# Delay S [8]
DRAM REF Cycle Time 2 [448]
DRAM REF Cycle Time Same Bank [Auto]
DRAM Refresh Interval [131071]
DRAM WRITE Recovery Time [24]
DRAM READ to PRE Time [12]
DRAM FOUR ACT WIN Time [32]
DRAM WRITE to READ Delay L [24]
DRAM WRITE to READ Delay S [10]
DRAM CKE Minimum Pulse Width [Auto]
DRAM Write Latency [30]
Ctl0 dqvrefup [154]
Ctl0 dqvrefdn [72]
Ctl0 dqodtvrefup [Auto]
Ctl0 dqodtvrefdn [Auto]
Ctl1 cmdvrefup [Auto]
Ctl1 ctlvrefup [Auto]
Ctl1 clkvrefup [Auto]
Ctl1 ckecsvrefup [Auto]
Ctl2 cmdvrefdn [Auto]
Ctl2 ctlvrefdn [Auto]
Ctl2 clkvrefdn [Auto]
Read Equalization RxEq Start Sign [-]
Read Equalization RxEq Start [Auto]
Read Equalization RxEq Stop Sign [-]
Read Equalization RxEq Stop [Auto]
ODT_READ_DURATION [Auto]
ODT_READ_DELAY [Auto]
ODT_WRITE_DURATION [Auto]
ODT_WRITE_DELAY [Auto]
DQ RTT WR [40 DRAM Clock]
DQ RTT NOM RD [40 DRAM Clock]
DQ RTT NOM WR [40 DRAM Clock]
DQ RTT PARK [34 DRAM Clock]
DQ RTT PARK DQS [34 DRAM Clock]
GroupA CA ODT [240 DRAM Clock]
GroupA CS ODT [0 DRAM Clock]
GroupA CK ODT [0 DRAM Clock]
GroupB CA ODT [60 DRAM Clock]
GroupB CS ODT [40 DRAM Clock]
GroupB CK ODT [40 DRAM Clock]
Pull-up Output Driver Impedance [34 DRAM Clock]
Pull-Down Output Driver Impedance [34 DRAM Clock]
DQ RTT WR [40 DRAM Clock]
DQ RTT NOM RD [40 DRAM Clock]
DQ RTT NOM WR [40 DRAM Clock]
DQ RTT PARK [34 DRAM Clock]
DQ RTT PARK DQS [34 DRAM Clock]
GroupA CA ODT [240 DRAM Clock]
GroupA CS ODT [0 DRAM Clock]
GroupA CK ODT [0 DRAM Clock]
GroupB CA ODT [60 DRAM Clock]
GroupB CS ODT [40 DRAM Clock]
GroupB CK ODT [40 DRAM Clock]
Pull-up Output Driver Impedance [34 DRAM Clock]
Pull-Down Output Driver Impedance [34 DRAM Clock]
Round Trip Latency Init Value MC0 CHA [Auto]
Round Trip Latency Max Value MC0 CHA [Auto]
Round Trip Latency Offset Value Mode Sign MC0 CHA [-]
Round Trip Latency Offset Value MC0 CHA [Auto]
Round Trip Latency Init Value MC0 CHB [Auto]
Round Trip Latency Max Value MC0 CHB [Auto]
Round Trip Latency Offset Value Mode Sign MC0 CHB [-]
Round Trip Latency Offset Value MC0 CHB [Auto]
Round Trip Latency Init Value MC1 CHA [Auto]
Round Trip Latency Max Value MC1 CHA [Auto]
Round Trip Latency Offset Value Mode Sign MC1 CHA [-]
Round Trip Latency Offset Value MC1 CHA [Auto]
Round Trip Latency Init Value MC1 CHB [Auto]
Round Trip Latency Max Value MC1 CHB [Auto]
Round Trip Latency Offset Value Mode Sign MC1 CHB [-]
Round Trip Latency Offset Value MC1 CHB [Auto]
Round Trip Latency MC0 CHA R0 [Auto]
Round Trip Latency MC0 CHA R1 [Auto]
Round Trip Latency MC0 CHA R2 [0]
Round Trip Latency MC0 CHA R3 [0]
Round Trip Latency MC0 CHA R4 [0]
Round Trip Latency MC0 CHA R5 [0]
Round Trip Latency MC0 CHA R6 [0]
Round Trip Latency MC0 CHA R7 [0]
Round Trip Latency MC0 CHB R0 [Auto]
Round Trip Latency MC0 CHB R1 [Auto]
Round Trip Latency MC0 CHB R2 [0]
Round Trip Latency MC0 CHB R3 [0]
Round Trip Latency MC0 CHB R4 [0]
Round Trip Latency MC0 CHB R5 [0]
Round Trip Latency MC0 CHB R6 [0]
Round Trip Latency MC0 CHB R7 [0]
Round Trip Latency MC1 CHA R0 [Auto]
Round Trip Latency MC1 CHA R1 [Auto]
Round Trip Latency MC1 CHA R2 [0]
Round Trip Latency MC1 CHA R3 [0]
Round Trip Latency MC1 CHA R4 [0]
Round Trip Latency MC1 CHA R5 [0]
Round Trip Latency MC1 CHA R6 [0]
Round Trip Latency MC1 CHA R7 [0]
Round Trip Latency MC1 CHB R0 [Auto]
Round Trip Latency MC1 CHB R1 [Auto]
Round Trip Latency MC1 CHB R2 [0]
Round Trip Latency MC1 CHB R3 [0]
Round Trip Latency MC1 CHB R4 [0]
Round Trip Latency MC1 CHB R5 [0]
Round Trip Latency MC1 CHB R6 [0]
Round Trip Latency MC1 CHB R7 [0]
Early Command Training [Auto]
SenseAmp Offset Training [Auto]
Early ReadMPR Timing Centering 2D [Auto]
Read MPR Training [Auto]
Receive Enable Training [Auto]
Jedec Write Leveling [Auto]
Early Write Time Centering 2D [Auto]
Early Read Time Centering 2D [Auto]
Write Timing Centering 1D [Auto]
Write Voltage Centering 1D [Auto]
Read Timing Centering 1D [Auto]
Read Timing Centering with JR [Auto]
Dimm ODT Training* [Disabled]
Max RTT_WR [ODT Off]
DIMM RON Training* [Disabled]
Write Drive Strength/Equalization 2D* [Auto]
Write Slew Rate Training* [Auto]
Read ODT Training* [Disabled]
Comp Optimization Training [Auto]
Read Equalization Training* [Auto]
Read Amplifier Training* [Auto]
Write Timing Centering 2D [Auto]
Read Timing Centering 2D [Auto]
Command Voltage Centering [Auto]
Early Command Voltage Centering [Auto]
Write Voltage Centering 2D [Auto]
Read Voltage Centering 2D [Auto]
Late Command Training [Auto]
Round Trip Latency [Auto]
Turn Around Timing Training [Auto]
CMD CTL CLK Slew Rate [Auto]
CMD/CTL DS & E 2D [Auto]
Read Voltage Centering 1D [Auto]
TxDqTCO Comp Training* [Auto]
ClkTCO Comp Training* [Auto]
TxDqsTCO Comp Training* [Auto]
VccDLL Bypass Training [Auto]
CMD/CTL Drive Strength Up/Dn 2D [Auto]
DIMM CA ODT Training [Auto]
PanicVttDnLp Training* [Auto]
Read Vref Decap Training* [Auto]
Vddq Training [Disabled]
Duty Cycle Correction Training [Auto]
Periodic DCC [Auto]
Rank Margin Tool Per Bit [Auto]
DIMM DFE Training [Auto]
EARLY DIMM DFE Training [Auto]
Tx Dqs Dcc Training [Auto]
DRAM DCA Training [Auto]
Write Driver Strength Training [Auto]
Rank Margin Tool [Auto]
Memory Test [Auto]
DIMM SPD Alias Test [Auto]
Receive Enable Centering 1D [Auto]
Retrain Margin Check [Auto]
Write Drive Strength Up/Dn independently [Auto]
LPDDR DqDqs Re-Training [Auto]
Margin Check Limit [Disabled]
tRDRD_sg_Training [Auto]
tRDRD_sg_Runtime [16]
tRDRD_dg_Training [Auto]
tRDRD_dg_Runtime [8]
tRDWR_sg [18]
tRDWR_dg [18]
tWRWR_sg [16]
tWRWR_dg [8]
tWRRD_sg [Auto]
tWRRD_dg [Auto]
tRDRD_dr [0]
tRDRD_dd [Auto]
tRDWR_dr [0]
tRDWR_dd [Auto]
tWRWR_dr [0]
tWRWR_dd [Auto]
tWRRD_dr [0]
tWRRD_dd [Auto]
tRPRE [Auto]
tWPRE [Auto]
tWPOST [Auto]
tWRPRE [Auto]
tPRPDEN [Auto]
tRDPDEN [Auto]
tWRPDEN [Auto]
tCPDED [Auto]
tREFIX9 [Auto]
Ref Interval [Auto]
tXPDLL [Auto]
tXP [Auto]
tPPD [Auto]
tCCD_L_tDLLK [Auto]
tZQCAL [Auto]
tZQCS [Auto]
OREF_RI [Auto]
Refresh Watermarks [High]
Refresh Hp Wm [Auto]
Refresh Panic Wm [Auto]
Refresh Abr Release [Auto]
tXSDLL [Auto]
tZQOPER [Auto]
tMOD [Auto]
CounttREFIWhileRefEn [Auto]
HPRefOnMRS [Auto]
SRX Ref Debits [Auto]
RAISE BLK WAIT [Auto]
Ref Stagger En [Auto]
Ref Stagger Mode [Auto]
Disable Stolen Refresh [Auto]
En Ref Type Display [Auto]
Trefipulse Stagger Disable [Auto]
tRPab ext [Auto]
derating ext [Auto]
Allow 2cyc B2B LPDDR [Auto]
tCSH [Auto]
tCSL [Auto]
powerdown Enable [Auto]
idle length [Auto]
raise cke after exit latency [Auto]
powerdown latency [Auto]
powerdown length [Auto]
selfrefresh latency [Auto]
selfrefresh length [Auto]
ckevalid length [Auto]
ckevalid enable [Auto]
idle enable [Auto]
selfrefresh enable [Auto]
Address mirror [Auto]
no gear4 param divide [Auto]
x8 device [Auto]
no gear2 param divide [Auto]
ddr 1dpc split ranks on subch [Auto]
write0 enable [Auto]
MultiCycCmd [Auto]
WCKDiffLowInIdle [Auto]
PBR Disable [Auto]
PBR OOO Dis [Auto]
PBR Disable on hot [Auto]
PBR Exit on Idle Cnt [Auto]
tXSR [Auto]
Dec tCWL [Auto]
Add tCWL [Auto]
Add 1Qclk delay [Auto]
MRC Fast Boot [Enabled]
MCH Full Check [Auto]
Mem Over Clock Fail Count [2]
Training Profile [Auto]
RxDfe [Auto]
Mrc Training Loop Count [2]
DRAM CLK Period [Auto]
Dll_bwsel [Auto]
Controller 0, Channel 0 Control [Enabled]
Controller 0, Channel 1 Control [Enabled]
Controller 1, Channel 0 Control [Enabled]
Controller 1, Channel 1 Control [Enabled]
MC_Vref0 [Auto]
MC_Vref1 [Auto]
MC_Vref2 [Auto]
Fine Granularity Refresh mode [Auto]
SDRAM Density Per Die [Auto]
SDRAM Banks Per Bank Group [Auto]
SDRAM Bank Groups [Auto]
Dynamic Memory Boost [Disabled]
Realtime Memory Frequency [Disabled]
SA GV [Disabled]
Voltage Monitor [Die Sense]
VRM Initialization Check [Enabled]
CPU Input Voltage Load-line Calibration [Auto]
CPU Load-line Calibration [Auto]
Synch ACDC Loadline with VRM Loadline [Disabled]
CPU Current Capability [Auto]
CPU Current Reporting [Auto]
Core Voltage Suspension [Auto]
CPU VRM Switching Frequency [Auto]
VRM Spread Spectrum [Auto]
CPU Power Duty Control [Auto]
CPU Power Phase Control [Auto]
CPU Power Thermal Control [125]
CPU Core/Cache Boot Voltage [Auto]
CPU Input Boot Voltage [Auto]
PLL Termination Boot Voltage [Auto]
CPU Standby Boot Voltage [Auto]
Memory Controller Boot Voltage [Auto]
CPU Core Auto Voltage Cap [Auto]
CPU Input Auto Voltage Cap [Auto]
Memory Controller Auto Voltage Cap [Auto]
Maximum CPU Core Temperature [85]
Fast Throttle Threshold [Auto]
Package Temperature Threshold [Auto]
Regulate Frequency by above Threshold [Auto]
IVR Transmitter VDDQ ICCMAX [Auto]
Unlimited ICCMAX [Auto]
CPU Core/Cache Current Limit Max. [Auto]
Long Duration Package Power Limit [275]
Package Power Time Window [Auto]
Short Duration Package Power Limit [290]
Dual Tau Boost [Disabled]
IA AC Load Line [0.06]
IA DC Load Line [Auto]
IA CEP Enable [Disabled]
SA CEP Enable [Disabled]
IA SoC Iccmax Reactive Protector [Auto]
Inverse Temperature Dependency Throttle [Auto]
IA VR Voltage Limit [1500]
CPU SVID Support [Auto]
Cache Dynamic OC Switcher [Disabled]
TVB Voltage Optimizations [Disabled]
Enhanced TVB [Disabled]
Overclocking TVB [Disabled]
Overclocking TVB Global Temperature Offset Sign [+]
Overclocking TVB Global Temperature Offset Value [Auto]
Offset Mode Sign 1 [+]
V/F Point 1 Offset [Auto]
Offset Mode Sign 2 [+]
V/F Point 2 Offset [Auto]
Offset Mode Sign 3 [+]
V/F Point 3 Offset [Auto]
Offset Mode Sign 4 [+]
V/F Point 4 Offset [Auto]
Offset Mode Sign 5 [+]
V/F Point 5 Offset [Auto]
Offset Mode Sign 6 [+]
V/F Point 6 Offset [Auto]
Offset Mode Sign 7 [+]
V/F Point 7 Offset [Auto]
Offset Mode Sign 8 [+]
V/F Point 8 Offset [Auto]
Offset Mode Sign 9 [+]
V/F Point 9 Offset [Auto]
Offset Mode Sign 10 [+]
V/F Point 10 Offset [Auto]
Offset Mode Sign 11 [+]
V/F Point 11 Offset [Auto]
Initial BCLK Frequency [Auto]
Runtime BCLK OC [Auto]
BCLK Amplitude [Auto]
BCLK Slew Rate [Auto]
BCLK Spread Spectrum [Auto]
Initial PCIE Frequency [Auto]
PCIE/DMI Amplitude [Auto]
PCIE/DMI Slew Rate [Auto]
PCIE/DMI Spread Spectrum [Auto]
Cold Boot PCIE Frequency [Auto]
Realtime Memory Timing [Disabled]
SPD Write Disable [TRUE]
PVD Ratio Threshold [Auto]
SA PLL Frequency Override [Auto]
BCLK TSC HW Fixup [Enabled]
Core Ratio Extension Mode [Disabled]
FLL OC mode [Auto]
UnderVolt Protection [Disabled]
Switch Microcode [Current Microcode]
Xtreme Tweaking [Disabled]
Core PLL Voltage [Auto]
GT PLL Voltage [Auto]
Ring PLL Voltage [Auto]
System Agent PLL Voltage [Auto]
Memory Controller PLL Voltage [Auto]
Efficient-core PLL Voltage [Auto]
CPU 1.8V Small Rail [Auto]
PLL Termination Voltage [Auto]
CPU Standby Voltage [Auto]
PCH 1.05V Voltage [Auto]
PCH 0.82V Voltage [Auto]
CPU Input Voltage Reset Voltage [Auto]
Eventual CPU Input Voltage [Auto]
Eventual Memory Controller Voltage [Auto]
Package Temperature Threshold [Auto]
Regulate Frequency by above Threshold [Auto]
Cooler Efficiency Customize [Keep Training]
Cooler Re-evaluation Algorithm [Normal]
Optimism Scale [100]
Ring Down Bin [Auto]
Min. CPU Cache Ratio [Auto]
Max. CPU Cache Ratio [Auto]
BCLK Aware Adaptive Voltage [Auto]
Actual VRM Core Voltage [Auto]
Global Core SVID Voltage [Auto]
Cache SVID Voltage [Auto]
CPU L2 Voltage [Auto]
CPU System Agent Voltage [Manual Mode]
- CPU System Agent Voltage Override [1.12000]
CPU Input Voltage [Auto]
High DRAM Voltage Mode [Enabled]
DRAM VDD Voltage [1.45000]
DRAM VDDQ Voltage [1.43000]
IVR Transmitter VDDQ Voltage [1.24000]
Memory Controller Voltage [1.21250]
MC Voltage Calculation Voltage Base [Auto]
VDD Calculation Voltage Base [Auto]
PMIC Voltages [Auto]
PCI Express Native Power Management [Enabled]
Native ASPM [Disabled]
DMI Link ASPM Control [Disabled]
ASPM [Auto]
L1 Substates [Disabled]
DMI ASPM [Disabled]
DMI Gen3 ASPM [Disabled]
PEG - ASPM [Disabled]
PCI Express Clock Gating [Enabled]
Hardware Prefetcher [Enabled]
Adjacent Cache Line Prefetch [Enabled]
Intel (VMX) Virtualization Technology [Disabled]
Per P-Core Control [Disabled]
Per E-Core Control [Disabled]
Active Performance Cores [All]
Active Efficient Cores [All]
Hyper-Threading [Enabled]
Hyper-Threading of Core 0 [Enabled]
Hyper-Threading of Core 1 [Enabled]
Hyper-Threading of Core 2 [Enabled]
Hyper-Threading of Core 3 [Enabled]
Hyper-Threading of Core 4 [Enabled]
Hyper-Threading of Core 5 [Enabled]
Hyper-Threading of Core 6 [Enabled]
Hyper-Threading of Core 7 [Enabled]
Total Memory Encryption [Disabled]
Legacy Game Compatibility Mode [Disabled]
Boot performance mode [Auto]
Intel(R) SpeedStep(tm) [Enabled]
Intel(R) Speed Shift Technology [Disabled]
Turbo Mode [Enabled]
Acoustic Noise Mitigation [Disabled]
CPU C-states [Auto]
Thermal Monitor [Enabled]
Dual Tau Boost [Disabled]
VT-d [Disabled]
Memory Remap [Enabled]
Enable VMD controller [Enabled]
Map PCIE Storage under VMD [Disabled]
Map SATA Controller under VMD [Disabled]
M.2_1 Link Speed [Auto]
PCIEX16(G5)_1 Link Speed [Auto]
PCIEX16(G5)_2 Link Speed [Auto]
PCIEX1(G4) Link Speed [Auto]
PCIEX4(G4) Link Speed [Auto]
M.2_2 Link Speed [Auto]
DIMM.2_1 Link Speed [Auto]
DIMM.2_2 Link Speed [Auto]
SATA Controller(s) [Enabled]
Aggressive LPM Support [Disabled]
SMART Self Test [Enabled]
M.2_3 [Enabled]
M.2_3 Hot Plug [Disabled]
SATA6G_1 [Enabled]
SATA6G_1 Hot Plug [Disabled]
SATA6G_2 [Enabled]
SATA6G_2 Hot Plug [Disabled]
SATA6G_3 [Enabled]
SATA6G_3 Hot Plug [Disabled]
SATA6G_4 [Enabled]
SATA6G_4 Hot Plug [Disabled]
PTT [Enable]
Intel(R) Dynamic Tuning Technology [Disabled]
PCIE Tunneling over USB4 [Enabled]
Discrete Thunderbolt(TM) Support [Disabled]
Security Device Support [Enable]
SHA256 PCR Bank [Enabled]
Pending operation [None]
Platform Hierarchy [Enabled]
Storage Hierarchy [Enabled]
Endorsement Hierarchy [Enabled]
Physical Presence Spec Version [1.3]
Disable Block Sid [Disabled]
Password protection of Runtime Variables [Enable]
Above 4G Decoding [Enabled]
Resize BAR Support [Enabled]
SR-IOV Support [Disabled]
Legacy USB Support [Enabled]
XHCI Hand-off [Enabled]
SanDisk [Auto]
LAN_U32G2_1 [Enabled]
U32G1_E5 [Enabled]
U32G1_E6 [Enabled]
U32G1_E7 [Enabled]
U32G1_E8 [Enabled]
U32G2X2_C3 [Enabled]
U32G2_5 [Enabled]
U32G2_6 [Enabled]
U32G2_7 [Enabled]
U32G2_P8 [Enabled]
U32G2X2_C9 [Enabled]
U32G1_E1 [Enabled]
U32G1_E2 [Enabled]
U32G1_E3 [Enabled]
U32G1_E4 [Enabled]
Network Stack [Disabled]
Device [N/A]
Restore AC Power Loss [Power Off]
Max Power Saving [Disabled]
ErP Ready [Disabled]
Power On By PCI-E [Disabled]
Power On By RTC [Disabled]
USB Audio [Enabled]
Intel LAN [Enabled]
USB power delivery in Soft Off state (S5) [Disabled]
Connectivity mode (Wi-Fi & Bluetooth) [Disabled]
When system is in working state [All On]
Q-Code LED Function [POST Code Only]
When system is in sleep, hibernate or soft off states [All On]
M.2_2 Configuration [Auto]
ASMedia USB 3.2 Controller_U32G1_E12 [Enabled]
ASMedia USB 3.2 Controller_U32G1_E34 [Enabled]
GNA Device [Disabled]
ASMedia Storage Controller [Enabled]
Windows Hot-plug Notification [Disabled]
ASPM Support [Disabled]
CPU Temperature [Monitor]
CPU Package Temperature [Monitor]
MotherBoard Temperature [Monitor]
VRM Temperature [Monitor]
Chipset Temperature [Monitor]
T_Sensor Temperature [Monitor]
DIMM.2 Sensor 1 Temperature [Monitor]
DIMM.2 Sensor 2 Temperature [Monitor]
Water In T Sensor Temperature [Monitor]
Water Out T Sensor Temperature [Monitor]
DIMM A1 Temperature [Monitor]
DIMM B1 Temperature [Monitor]
CPU Fan Speed [Monitor]
CPU Optional Fan Speed [Monitor]
Chassis Fan 1 Speed [Monitor]
Chassis Fan 2 Speed [Monitor]
Chassis Fan 3 Speed [Monitor]
Water Pump+ Speed [Monitor]
AIO Pump Speed [Monitor]
Flow Rate [Monitor]
CPU Core Voltage [Monitor]
12V Voltage [Monitor]
5V Voltage [Monitor]
3.3V Voltage [Monitor]
Memory Controller Voltage [Monitor]
CPU Fan Q-Fan Control [DC Mode]
CPU Fan Profile [Standard]
CPU Fan Q-Fan Source [CPU]
CPU Fan Step Up [Level 0]
CPU Fan Step Down [Level 4]
CPU Fan Speed Low Limit [200 RPM]
Chassis Fan 1 Q-Fan Control [Auto Detect]
Chassis Fan 1 Profile [Standard]
Chassis Fan 1 Q-Fan Source [CPU]
Chassis Fan 1 Step Up [Level 0]
Chassis Fan 1 Step Down [Level 0]
Chassis Fan 1 Speed Low Limit [200 RPM]
Chassis Fan 2 Q-Fan Control [PWM Mode]
Chassis Fan 2 Profile [Standard]
Chassis Fan 2 Q-Fan Source [Chipset]
Chassis Fan 2 Step Up [Level 0]
Chassis Fan 2 Step Down [Level 4]
Chassis Fan 2 Speed Low Limit [200 RPM]
Chassis Fan 3 Q-Fan Control [DC Mode]
Chassis Fan 3 Profile [Silent]
Chassis Fan 3 Q-Fan Source [CPU]
Chassis Fan 3 Step Up [Level 0]
Chassis Fan 3 Step Down [Level 0]
Chassis Fan 3 Speed Low Limit [200 RPM]
Water Pump+ Q-Fan Control [PWM Mode]
Water Pump+ Profile [Manual]
Water Pump+ Q-Fan Source [CPU]
Water Pump+ Step Up [Level 0]
Water Pump+ Step Down [Level 4]
Water Pump+ Speed Low Limit [Ignore]
Water Pump+ Point4 Temperature [70]
Water Pump+ Point4 Duty Cycle (%) [100]
Water Pump+ Point3 Temperature [50]
Water Pump+ Point3 Duty Cycle (%) [85]
Water Pump+ Point2 Temperature [40]
Water Pump+ Point2 Duty Cycle (%) [80]
Water Pump+ Point1 Temperature [25]
Water Pump+ Point1 Duty Cycle (%) [60]
AIO Pump Q-Fan Control [Auto Detect]
AIO Pump Profile [Full Speed]
CPU Temperature LED Switch [Enabled]
Launch CSM [Disabled]
OS Type [Other OS]
Secure Boot Mode [Custom]
Fast Boot [Enabled]
Next Boot after AC Power Loss [Fast Boot]
Boot Logo Display [Auto]
POST Delay Time [3 sec]
Bootup NumLock State [On]
Wait For 'F1' If Error [Enabled]
Option ROM Messages [Force BIOS]
Interrupt 19 Capture [Disabled]
AMI Native NVMe Driver Support [Enabled]
Setup Mode [Advanced Mode]
Boot Sector (MBR/GPT) Recovery Policy [Local User Control]
Next Boot Recovery Action [Skip]
BIOS Image Rollback Support [Enabled]
Publish HII Resources [Disabled]
Flexkey [Safe Boot]
Setup Animator [Disabled]
Load from Profile [7]
Profile Name [7200CL32*42*42]
Save to Profile [7]
DIMM Slot Number [DIMM_A1]
Download & Install ARMOURY CRATE app [Disabled]
Download & Install MyASUS service & app [Disabled]
Ai Overclock Tuner [Auto]
Intel(R) Adaptive Boost Technology [Auto]
ASUS MultiCore Enhancement [Auto – Lets BIOS Optimize]
SVID Behavior [Auto]
BCLK Frequency : DRAM Frequency Ratio [100:100]
Memory Controller : DRAM Frequency Ratio [1:2]
DRAM Frequency [DDR5-7200MHz]
Performance Core Ratio [By Core Usage]
1-Core Ratio Limit [55]
2-Core Ratio Limit [55]
3-Core Ratio Limit [55]
4-Core Ratio Limit [55]
5-Core Ratio Limit [55]
6-Core Ratio Limit [55]
7-Core Ratio Limit [55]
8-Core Ratio Limit [55]
Performance Core0 Specific Ratio Limit [Auto]
Performance Core0 specific Voltage [Auto]
Performance Core1 Specific Ratio Limit [Auto]
Performance Core1 specific Voltage [Auto]
*Performance Core2 Specific Ratio Limit [Auto]
Performance Core2 specific Voltage [Auto]
*Performance Core3 Specific Ratio Limit [Auto]
Performance Core3 specific Voltage [Auto]
Performance Core4 Specific Ratio Limit [Auto]
Performance Core4 specific Voltage [Auto]
Performance Core5 Specific Ratio Limit [Auto]
Performance Core5 specific Voltage [Auto]
Performance Core6 Specific Ratio Limit [Auto]
Performance Core6 specific Voltage [Auto]
Performance Core7 Specific Ratio Limit [Auto]
Performance Core7 specific Voltage [Auto]
Efficient Core Ratio [By Core Usage]
Efficient Turbo Ratio Limit 1 [Auto]
Efficient Turbo Ratio Cores 1 [Auto]
Efficient Core Group0 Specific Ratio Limit [Auto]
Efficient Core Group0 specific Voltage [Auto]
Efficient Core Group1 Specific Ratio Limit [Auto]
Efficient Core Group1 specific Voltage [Auto]
Efficient Core Group2 Specific Ratio Limit [Auto]
Efficient Core Group2 specific Voltage [Auto]
Efficient Core Group3 Specific Ratio Limit [Auto]
Efficient Core Group3 specific Voltage [Auto]
AVX2 [Enabled]
AVX2 Ratio Offset to per-core Ratio Limit [User Specify]
AVX2 Ratio Offset [0]
AVX2 Voltage Guardband Scale Factor [User Specify]
AVX2 Voltage Guardband Scale Factor [0]
Maximus Tweak [Mode 2]
DRAM CAS# Latency [32]
DRAM RAS# to CAS# Delay Read [42]
DRAM RAS# to CAS# Delay Write [16]
DRAM RAS# PRE Time [42]
DRAM RAS# ACT Time [54]
DRAM Command Rate [2N]
DRAM RAS# to RAS# Delay L [12]
DRAM RAS# to RAS# Delay S [8]
DRAM REF Cycle Time 2 [448]
DRAM REF Cycle Time Same Bank [Auto]
DRAM Refresh Interval [131071]
DRAM WRITE Recovery Time [24]
DRAM READ to PRE Time [12]
DRAM FOUR ACT WIN Time [32]
DRAM WRITE to READ Delay L [24]
DRAM WRITE to READ Delay S [10]
DRAM CKE Minimum Pulse Width [Auto]
DRAM Write Latency [30]
Ctl0 dqvrefup [154]
Ctl0 dqvrefdn [72]
Ctl0 dqodtvrefup [Auto]
Ctl0 dqodtvrefdn [Auto]
Ctl1 cmdvrefup [Auto]
Ctl1 ctlvrefup [Auto]
Ctl1 clkvrefup [Auto]
Ctl1 ckecsvrefup [Auto]
Ctl2 cmdvrefdn [Auto]
Ctl2 ctlvrefdn [Auto]
Ctl2 clkvrefdn [Auto]
Read Equalization RxEq Start Sign [-]
Read Equalization RxEq Start [Auto]
Read Equalization RxEq Stop Sign [-]
Read Equalization RxEq Stop [Auto]
ODT_READ_DURATION [Auto]
ODT_READ_DELAY [Auto]
ODT_WRITE_DURATION [Auto]
ODT_WRITE_DELAY [Auto]
DQ RTT WR [40 DRAM Clock]
DQ RTT NOM RD [40 DRAM Clock]
DQ RTT NOM WR [40 DRAM Clock]
DQ RTT PARK [34 DRAM Clock]
DQ RTT PARK DQS [34 DRAM Clock]
GroupA CA ODT [240 DRAM Clock]
GroupA CS ODT [0 DRAM Clock]
GroupA CK ODT [0 DRAM Clock]
GroupB CA ODT [60 DRAM Clock]
GroupB CS ODT [40 DRAM Clock]
GroupB CK ODT [40 DRAM Clock]
Pull-up Output Driver Impedance [34 DRAM Clock]
Pull-Down Output Driver Impedance [34 DRAM Clock]
DQ RTT WR [40 DRAM Clock]
DQ RTT NOM RD [40 DRAM Clock]
DQ RTT NOM WR [40 DRAM Clock]
DQ RTT PARK [34 DRAM Clock]
DQ RTT PARK DQS [34 DRAM Clock]
GroupA CA ODT [240 DRAM Clock]
GroupA CS ODT [0 DRAM Clock]
GroupA CK ODT [0 DRAM Clock]
GroupB CA ODT [60 DRAM Clock]
GroupB CS ODT [40 DRAM Clock]
GroupB CK ODT [40 DRAM Clock]
Pull-up Output Driver Impedance [34 DRAM Clock]
Pull-Down Output Driver Impedance [34 DRAM Clock]
Round Trip Latency Init Value MC0 CHA [Auto]
Round Trip Latency Max Value MC0 CHA [Auto]
Round Trip Latency Offset Value Mode Sign MC0 CHA [-]
Round Trip Latency Offset Value MC0 CHA [Auto]
Round Trip Latency Init Value MC0 CHB [Auto]
Round Trip Latency Max Value MC0 CHB [Auto]
Round Trip Latency Offset Value Mode Sign MC0 CHB [-]
Round Trip Latency Offset Value MC0 CHB [Auto]
Round Trip Latency Init Value MC1 CHA [Auto]
Round Trip Latency Max Value MC1 CHA [Auto]
Round Trip Latency Offset Value Mode Sign MC1 CHA [-]
Round Trip Latency Offset Value MC1 CHA [Auto]
Round Trip Latency Init Value MC1 CHB [Auto]
Round Trip Latency Max Value MC1 CHB [Auto]
Round Trip Latency Offset Value Mode Sign MC1 CHB [-]
Round Trip Latency Offset Value MC1 CHB [Auto]
Round Trip Latency MC0 CHA R0 [Auto]
Round Trip Latency MC0 CHA R1 [Auto]
Round Trip Latency MC0 CHA R2 [0]
Round Trip Latency MC0 CHA R3 [0]
Round Trip Latency MC0 CHA R4 [0]
Round Trip Latency MC0 CHA R5 [0]
Round Trip Latency MC0 CHA R6 [0]
Round Trip Latency MC0 CHA R7 [0]
Round Trip Latency MC0 CHB R0 [Auto]
Round Trip Latency MC0 CHB R1 [Auto]
Round Trip Latency MC0 CHB R2 [0]
Round Trip Latency MC0 CHB R3 [0]
Round Trip Latency MC0 CHB R4 [0]
Round Trip Latency MC0 CHB R5 [0]
Round Trip Latency MC0 CHB R6 [0]
Round Trip Latency MC0 CHB R7 [0]
Round Trip Latency MC1 CHA R0 [Auto]
Round Trip Latency MC1 CHA R1 [Auto]
Round Trip Latency MC1 CHA R2 [0]
Round Trip Latency MC1 CHA R3 [0]
Round Trip Latency MC1 CHA R4 [0]
Round Trip Latency MC1 CHA R5 [0]
Round Trip Latency MC1 CHA R6 [0]
Round Trip Latency MC1 CHA R7 [0]
Round Trip Latency MC1 CHB R0 [Auto]
Round Trip Latency MC1 CHB R1 [Auto]
Round Trip Latency MC1 CHB R2 [0]
Round Trip Latency MC1 CHB R3 [0]
Round Trip Latency MC1 CHB R4 [0]
Round Trip Latency MC1 CHB R5 [0]
Round Trip Latency MC1 CHB R6 [0]
Round Trip Latency MC1 CHB R7 [0]
Early Command Training [Auto]
SenseAmp Offset Training [Auto]
Early ReadMPR Timing Centering 2D [Auto]
Read MPR Training [Auto]
Receive Enable Training [Auto]
Jedec Write Leveling [Auto]
Early Write Time Centering 2D [Auto]
Early Read Time Centering 2D [Auto]
Write Timing Centering 1D [Auto]
Write Voltage Centering 1D [Auto]
Read Timing Centering 1D [Auto]
Read Timing Centering with JR [Auto]
Dimm ODT Training* [Disabled]
Max RTT_WR [ODT Off]
DIMM RON Training* [Disabled]
Write Drive Strength/Equalization 2D* [Auto]
Write Slew Rate Training* [Auto]
Read ODT Training* [Disabled]
Comp Optimization Training [Auto]
Read Equalization Training* [Auto]
Read Amplifier Training* [Auto]
Write Timing Centering 2D [Auto]
Read Timing Centering 2D [Auto]
Command Voltage Centering [Auto]
Early Command Voltage Centering [Auto]
Write Voltage Centering 2D [Auto]
Read Voltage Centering 2D [Auto]
Late Command Training [Auto]
Round Trip Latency [Auto]
Turn Around Timing Training [Auto]
CMD CTL CLK Slew Rate [Auto]
CMD/CTL DS & E 2D [Auto]
Read Voltage Centering 1D [Auto]
TxDqTCO Comp Training* [Auto]
ClkTCO Comp Training* [Auto]
TxDqsTCO Comp Training* [Auto]
VccDLL Bypass Training [Auto]
CMD/CTL Drive Strength Up/Dn 2D [Auto]
DIMM CA ODT Training [Auto]
PanicVttDnLp Training* [Auto]
Read Vref Decap Training* [Auto]
Vddq Training [Disabled]
Duty Cycle Correction Training [Auto]
Periodic DCC [Auto]
Rank Margin Tool Per Bit [Auto]
DIMM DFE Training [Auto]
EARLY DIMM DFE Training [Auto]
Tx Dqs Dcc Training [Auto]
DRAM DCA Training [Auto]
Write Driver Strength Training [Auto]
Rank Margin Tool [Auto]
Memory Test [Auto]
DIMM SPD Alias Test [Auto]
Receive Enable Centering 1D [Auto]
Retrain Margin Check [Auto]
Write Drive Strength Up/Dn independently [Auto]
LPDDR DqDqs Re-Training [Auto]
Margin Check Limit [Disabled]
tRDRD_sg_Training [Auto]
tRDRD_sg_Runtime [16]
tRDRD_dg_Training [Auto]
tRDRD_dg_Runtime [8]
tRDWR_sg [18]
tRDWR_dg [18]
tWRWR_sg [16]
tWRWR_dg [8]
tWRRD_sg [Auto]
tWRRD_dg [Auto]
tRDRD_dr [0]
tRDRD_dd [Auto]
tRDWR_dr [0]
tRDWR_dd [Auto]
tWRWR_dr [0]
tWRWR_dd [Auto]
tWRRD_dr [0]
tWRRD_dd [Auto]
tRPRE [Auto]
tWPRE [Auto]
tWPOST [Auto]
tWRPRE [Auto]
tPRPDEN [Auto]
tRDPDEN [Auto]
tWRPDEN [Auto]
tCPDED [Auto]
tREFIX9 [Auto]
Ref Interval [Auto]
tXPDLL [Auto]
tXP [Auto]
tPPD [Auto]
tCCD_L_tDLLK [Auto]
tZQCAL [Auto]
tZQCS [Auto]
OREF_RI [Auto]
Refresh Watermarks [High]
Refresh Hp Wm [Auto]
Refresh Panic Wm [Auto]
Refresh Abr Release [Auto]
tXSDLL [Auto]
tZQOPER [Auto]
tMOD [Auto]
CounttREFIWhileRefEn [Auto]
HPRefOnMRS [Auto]
SRX Ref Debits [Auto]
RAISE BLK WAIT [Auto]
Ref Stagger En [Auto]
Ref Stagger Mode [Auto]
Disable Stolen Refresh [Auto]
En Ref Type Display [Auto]
Trefipulse Stagger Disable [Auto]
tRPab ext [Auto]
derating ext [Auto]
Allow 2cyc B2B LPDDR [Auto]
tCSH [Auto]
tCSL [Auto]
powerdown Enable [Auto]
idle length [Auto]
raise cke after exit latency [Auto]
powerdown latency [Auto]
powerdown length [Auto]
selfrefresh latency [Auto]
selfrefresh length [Auto]
ckevalid length [Auto]
ckevalid enable [Auto]
idle enable [Auto]
selfrefresh enable [Auto]
Address mirror [Auto]
no gear4 param divide [Auto]
x8 device [Auto]
no gear2 param divide [Auto]
ddr 1dpc split ranks on subch [Auto]
write0 enable [Auto]
MultiCycCmd [Auto]
WCKDiffLowInIdle [Auto]
PBR Disable [Auto]
PBR OOO Dis [Auto]
PBR Disable on hot [Auto]
PBR Exit on Idle Cnt [Auto]
tXSR [Auto]
Dec tCWL [Auto]
Add tCWL [Auto]
Add 1Qclk delay [Auto]
MRC Fast Boot [Enabled]
MCH Full Check [Auto]
Mem Over Clock Fail Count [2]
Training Profile [Auto]
RxDfe [Auto]
Mrc Training Loop Count [2]
DRAM CLK Period [Auto]
Dll_bwsel [Auto]
Controller 0, Channel 0 Control [Enabled]
Controller 0, Channel 1 Control [Enabled]
Controller 1, Channel 0 Control [Enabled]
Controller 1, Channel 1 Control [Enabled]
MC_Vref0 [Auto]
MC_Vref1 [Auto]
MC_Vref2 [Auto]
Fine Granularity Refresh mode [Auto]
SDRAM Density Per Die [Auto]
SDRAM Banks Per Bank Group [Auto]
SDRAM Bank Groups [Auto]
Dynamic Memory Boost [Disabled]
Realtime Memory Frequency [Disabled]
SA GV [Disabled]
Voltage Monitor [Die Sense]
VRM Initialization Check [Enabled]
CPU Input Voltage Load-line Calibration [Auto]
CPU Load-line Calibration [Auto]
Synch ACDC Loadline with VRM Loadline [Disabled]
CPU Current Capability [Auto]
CPU Current Reporting [Auto]
Core Voltage Suspension [Auto]
CPU VRM Switching Frequency [Auto]
VRM Spread Spectrum [Auto]
CPU Power Duty Control [Auto]
CPU Power Phase Control [Auto]
CPU Power Thermal Control [125]
CPU Core/Cache Boot Voltage [Auto]
CPU Input Boot Voltage [Auto]
PLL Termination Boot Voltage [Auto]
CPU Standby Boot Voltage [Auto]
Memory Controller Boot Voltage [Auto]
CPU Core Auto Voltage Cap [Auto]
CPU Input Auto Voltage Cap [Auto]
Memory Controller Auto Voltage Cap [Auto]
Maximum CPU Core Temperature [85]
Fast Throttle Threshold [Auto]
Package Temperature Threshold [Auto]
Regulate Frequency by above Threshold [Auto]
IVR Transmitter VDDQ ICCMAX [Auto]
Unlimited ICCMAX [Auto]
CPU Core/Cache Current Limit Max. [Auto]
Long Duration Package Power Limit [275]
Package Power Time Window [Auto]
Short Duration Package Power Limit [290]
Dual Tau Boost [Disabled]
IA AC Load Line [0.06]
IA DC Load Line [Auto]
IA CEP Enable [Disabled]
SA CEP Enable [Disabled]
IA SoC Iccmax Reactive Protector [Auto]
Inverse Temperature Dependency Throttle [Auto]
IA VR Voltage Limit [1500]
CPU SVID Support [Auto]
Cache Dynamic OC Switcher [Disabled]
TVB Voltage Optimizations [Disabled]
Enhanced TVB [Disabled]
Overclocking TVB [Disabled]
Overclocking TVB Global Temperature Offset Sign [+]
Overclocking TVB Global Temperature Offset Value [Auto]
Offset Mode Sign 1 [+]
V/F Point 1 Offset [Auto]
Offset Mode Sign 2 [+]
V/F Point 2 Offset [Auto]
Offset Mode Sign 3 [+]
V/F Point 3 Offset [Auto]
Offset Mode Sign 4 [+]
V/F Point 4 Offset [Auto]
Offset Mode Sign 5 [+]
V/F Point 5 Offset [Auto]
Offset Mode Sign 6 [+]
V/F Point 6 Offset [Auto]
Offset Mode Sign 7 [+]
V/F Point 7 Offset [Auto]
Offset Mode Sign 8 [+]
V/F Point 8 Offset [Auto]
Offset Mode Sign 9 [+]
V/F Point 9 Offset [Auto]
Offset Mode Sign 10 [+]
V/F Point 10 Offset [Auto]
Offset Mode Sign 11 [+]
V/F Point 11 Offset [Auto]
Initial BCLK Frequency [Auto]
Runtime BCLK OC [Auto]
BCLK Amplitude [Auto]
BCLK Slew Rate [Auto]
BCLK Spread Spectrum [Auto]
Initial PCIE Frequency [Auto]
PCIE/DMI Amplitude [Auto]
PCIE/DMI Slew Rate [Auto]
PCIE/DMI Spread Spectrum [Auto]
Cold Boot PCIE Frequency [Auto]
Realtime Memory Timing [Disabled]
SPD Write Disable [TRUE]
PVD Ratio Threshold [Auto]
SA PLL Frequency Override [Auto]
BCLK TSC HW Fixup [Enabled]
Core Ratio Extension Mode [Disabled]
FLL OC mode [Auto]
UnderVolt Protection [Disabled]
Switch Microcode [Current Microcode]
Xtreme Tweaking [Disabled]
Core PLL Voltage [Auto]
GT PLL Voltage [Auto]
Ring PLL Voltage [Auto]
System Agent PLL Voltage [Auto]
Memory Controller PLL Voltage [Auto]
Efficient-core PLL Voltage [Auto]
CPU 1.8V Small Rail [Auto]
PLL Termination Voltage [Auto]
CPU Standby Voltage [Auto]
PCH 1.05V Voltage [Auto]
PCH 0.82V Voltage [Auto]
CPU Input Voltage Reset Voltage [Auto]
Eventual CPU Input Voltage [Auto]
Eventual Memory Controller Voltage [Auto]
Package Temperature Threshold [Auto]
Regulate Frequency by above Threshold [Auto]
Cooler Efficiency Customize [Keep Training]
Cooler Re-evaluation Algorithm [Normal]
Optimism Scale [100]
Ring Down Bin [Auto]
Min. CPU Cache Ratio [Auto]
Max. CPU Cache Ratio [Auto]
BCLK Aware Adaptive Voltage [Auto]
Actual VRM Core Voltage [Auto]
Global Core SVID Voltage [Auto]
Cache SVID Voltage [Auto]
CPU L2 Voltage [Auto]
CPU System Agent Voltage [Manual Mode]
- CPU System Agent Voltage Override [1.12000]
CPU Input Voltage [Auto]
High DRAM Voltage Mode [Enabled]
DRAM VDD Voltage [1.45000]
DRAM VDDQ Voltage [1.43000]
IVR Transmitter VDDQ Voltage [1.24000]
Memory Controller Voltage [1.21250]
MC Voltage Calculation Voltage Base [Auto]
VDD Calculation Voltage Base [Auto]
PMIC Voltages [Auto]
PCI Express Native Power Management [Enabled]
Native ASPM [Disabled]
DMI Link ASPM Control [Disabled]
ASPM [Auto]
L1 Substates [Disabled]
DMI ASPM [Disabled]
DMI Gen3 ASPM [Disabled]
PEG - ASPM [Disabled]
PCI Express Clock Gating [Enabled]
Hardware Prefetcher [Enabled]
Adjacent Cache Line Prefetch [Enabled]
Intel (VMX) Virtualization Technology [Disabled]
Per P-Core Control [Disabled]
Per E-Core Control [Disabled]
Active Performance Cores [All]
Active Efficient Cores [All]
Hyper-Threading [Enabled]
Hyper-Threading of Core 0 [Enabled]
Hyper-Threading of Core 1 [Enabled]
Hyper-Threading of Core 2 [Enabled]
Hyper-Threading of Core 3 [Enabled]
Hyper-Threading of Core 4 [Enabled]
Hyper-Threading of Core 5 [Enabled]
Hyper-Threading of Core 6 [Enabled]
Hyper-Threading of Core 7 [Enabled]
Total Memory Encryption [Disabled]
Legacy Game Compatibility Mode [Disabled]
Boot performance mode [Auto]
Intel(R) SpeedStep(tm) [Enabled]
Intel(R) Speed Shift Technology [Disabled]
Turbo Mode [Enabled]
Acoustic Noise Mitigation [Disabled]
CPU C-states [Auto]
Thermal Monitor [Enabled]
Dual Tau Boost [Disabled]
VT-d [Disabled]
Memory Remap [Enabled]
Enable VMD controller [Enabled]
Map PCIE Storage under VMD [Disabled]
Map SATA Controller under VMD [Disabled]
M.2_1 Link Speed [Auto]
PCIEX16(G5)_1 Link Speed [Auto]
PCIEX16(G5)_2 Link Speed [Auto]
PCIEX1(G4) Link Speed [Auto]
PCIEX4(G4) Link Speed [Auto]
M.2_2 Link Speed [Auto]
DIMM.2_1 Link Speed [Auto]
DIMM.2_2 Link Speed [Auto]
SATA Controller(s) [Enabled]
Aggressive LPM Support [Disabled]
SMART Self Test [Enabled]
M.2_3 [Enabled]
M.2_3 Hot Plug [Disabled]
SATA6G_1 [Enabled]
SATA6G_1 Hot Plug [Disabled]
SATA6G_2 [Enabled]
SATA6G_2 Hot Plug [Disabled]
SATA6G_3 [Enabled]
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Anhänge
Zuletzt bearbeitet:
Ich glaub die M-Dies liefen problemlos mit 4
. 8 müsste bei ihm eigentlich auch gehen, aber in der Tat trrd 12 und 12 tFAW dann auf 48. Ich denke aber wie geschrieben eher das die twrrd_dg bei ihm der Übeltäter ist speziell nach längerer Zeit.Hm ?
Wenn du bei RD 2 RD meinst
Dann einfach da der CPU Host bzw IMC auf niedrigerem geht, aber weiterhin auf dem Ramstick (UDIMM) Roundtrip nun mal 2*8 cycles lang sind.
Burst, sprich getrennter Read oder getrennter Write ~ sind 8 cycles.
Alles drunter und drüber verschiebt sich bis es mal ein gesamten Cycle aussetzt.
Das wären in dem fall die 50-75% langsamer mit zb RDRD 7 anstelle 8
7 werden versucht geladen zu werden, und je nach Status durch einen vorherigen Command einfach angereiht.
Alles was du sendest wird versucht gerannt zu werden.
Die Effektivität davon, bleibt ein Streitthema.
AMD rennt tBURST fixiert auf 3, aber hat processing delays.
Intel womöglich auf 4 (besten Fall)
Potentiell kommt man mit zb 12 anstelle 16 bei RDRD_sg (same group = roundtrip) weiter.
Aber sowas abenteuerliches funktioniert nur auf 6000-6400MT/s.
2N als solches wird so oder so jeden 2. Cycle mit dem CPU host synchronisiert (+ weitere minimale Nachteile)
Und eigentlich spielt es auch kaum eine Rolle ob es nun 1N wäre, den die "Ausrichtung" geschehe weiterhin in 8 nCK.
Ob es einem gefällt oder nicht. Ausnahmen wären Logical-Rank abusing aber UDIMM ist dafür nicht designed. Nur RDIMM kann echtes dualrank~
Natürlich geht dann zb auch WRWR_Roundtrip als 12 durch anstelle 16 ~ wobei es ja 32 zu sein hat
(hätten wir uns an den Specs gehalten und die DIMMs als komplette 64bit channels zugeschalten anstelle doppelte 32bit)
Aber specifications und Realität sind minimal Unterschiedlich. Dennoch sind es faktuale Specifications
Writes als solches können bis zu 2 pro BurstChop (half roundtrip) ausgeführt werden und werden nicht Opfer von Discharge-Penalty.
Ein Teil des Grundes, weswegen WTR als half und nicht mit 8 startet. Natürlich spielen hier auch die 2 Subchannels pro Dimmseite eine Rolle,
Aber sowas ging auch mit DDR4
Je nach CPU Architektur, und natürlich command size ~ page size inkludiert.
Kann man es hinbekommen dass es 1:1 sich transferiert und sozusagen ein ganzen Cycle gewinnt.
Doch ob das nun für 2 ticks 1+1 Read und 2+2 Writes
Oder ob es 1+0(+1) Read (falls 15 anstelle 16 RDRD)
Und 1+1+1, anstelle 2+2 Writes wären
Man sollte darüber mal logisch nachdenken
~ nicht dich direkt betreffendSelbstverständlich geht vieles, wie gesagt IC's sind dämlich 🤭 Sie werden das versuchen was du ihnen sagst und errorn direkt oder erzwingen eine Korrektur dank PPR. (ODECC)
Sollte der SPD-Hub vorher deinen abenteuerlichen Versuch nicht korrigieren lassen. Je nachdem welche Art von PPR in dem EEPROM vom Stick einprogrammiert wurde.
Ausgeführt wird es dennoch ~ man verschwendet halt komplett die Cycles.
Das selbe mit zu tiefen RAS. Leute schauen darauf als "single command" = Book Theory.
In der Realität geschieht vieles angereiht und nacheinander. Ebenso wäre RAS kein garantierter RowHit. CAS schon
G'Morgen
Ah sorry,
Wenn du Ras2RAS (RRD) und FAW meinst
Erstens wäre FAW komplett getrennt von RRD. DDR5 exclusive !
FAW hängt davon ab auf welcher Pagesize der Dimmstick gebaut wurde, und welche Größe maximal von den ICs selber ausgehen kann. Natürlich auch von dem CPU Host, aber er ist modular.
Für uns ist es immer 1KB aka tFAW 32.
Für 2KB kleine ICs wäre es tFAW 40.
Wie immer , "je nachdem"
16 gehe durch da wir jeden Subchannel einzelln ansprechen. Dennoch hängen wir in der BurstStrobe limitierung von 16 auf dem Dimmsticks.
Egal wie man es massiert. Der Ram wird nicht plötzlich 4 nCK cycles können 🤭 Das ist nicht RDIMM ! & ebenso nicht DDR4.
Jeder UDIMM kann keine 2 commands per cycle senden. Somit kann kein UDIMM reines DualRank werden. Je nach schaltung kann man allerdings mit virtual ranks arbeiten sowie subchannels.
Da du wie gesagt commands in 8nCK ausführst.
Macht es wenig Sinn wenn der RAS zu RAS delay , aka transfer delay zwischen bankgroups auf 4 cycles wäre.
Du kannst beide subchannels nicht gleichzeitig ansprechen. Nun ansprechen schon, jedoch nur daten transferieren (writes) aber nichts ausführen wenn kein read so schnell ausgeführt werden kann.
Sprich ein cycle setzt aus, und erstellt unnötigen Stress (schlechte Signal-Integrity)
Dennoch sozusagen eine Zeitverschwendung, wenn Pro cycle schon 2 Writes angereiht werden können.
Sprich minimum 8 nCK für RRD und 4 für WTR. Ganz einfach
Heißt CCD_Short 8, CCD_Long wäre dann je nachdem minimum 8 oder mehr.
Beitrag automatisch zusammengeführt:
Ich hatte noch etwas vergessen,
RAS 2 RAS delay kann um 1nCK verlangsamt werden.
CCD_S muss nicht unbedingt auf 8 bleiben.
Sowas wird allerdings nur genutzt wenn dein Ram stick intern einfach zu langsam ist.
nCK "Geschwindigkeit" ~ hängt auch von den MT/s ab. tCK wird immer kleiner und kleiner je höher du gehst
Die 8 cycles minimum , sind ein design limit - diese 8 nCK können allerdings ganz schnell zuu kurz werden.
Zb bei 9000MT/s und höher. 11 000MT/s ++
Man weiß es nicht genau, aber bei DDR4 waren das etwa nahe 4600MT/s, worin nur manche die 5000MT/s konnten.
Ich muss für 4200 15-15 (8400 30-30) nun mal DDR5 RRD's rennen(6-7 bzw 7-9), da das arme A0 PCB es einfach nicht schneller kann~
Und ja, es gibt einen Unterschied zwischen short-primaries, und long primary-2-primary delay
Das Primary Päckchen als ganzes ist 7-8* (halb auf DDR4) so lange wie ein kleiner RRD command.Ich hörte hier und da dass langsame RRD's "unnötig" wären.
Leider sieht man auch hier den ganzen Wald nicht, wenn man nur auf das eine Bäumchen starrt 🤭
Bzw der gesamte Blumenstrauch, wenn man nur das blühen einer Blüte beobachtet. Vieles geschieht außerhalb der Perspektive;
Leider leider auch das selbe mit unseren kleinen Benchmarks, welche kaum 1nen IC belasten.
In der Realität werden daten nur im oberen Teil der Bankgroups verteilt. BG pro BG pro BG
Geteilt in banks, bevor es zu anderen ICs springt. Um alle gut verwenden zu können, bevor man auf long-delays (zurück zum start) rückgreifen muss.
Wo soll man hier genau irgendwelche "Leistungszuwachse" sehen, wenn das was du damit testest kaum einen IC verlässt 🤭
Zuletzt bearbeitet:
chilchiubito
Experte
1801 Bios fürs Apex White läuft bei mir schlechter als 1601. Bekomme 8200cl36 darauf nicht stabil.. Versuche mal 8400cl38 stabil zu bekommen bevor ich das 1703 Bios mal austeste.
Das soll wohl bei einigen besser laufen für RAM OC.
Jede Spannung muss gesweetspottet werden.. Das ist echt so zeitaufwendig 🙃
Das soll wohl bei einigen besser laufen für RAM OC.
Beitrag automatisch zusammengeführt:
Jede Spannung muss gesweetspottet werden.. Das ist echt so zeitaufwendig 🙃
Darkthrone
Profi
So, hab mein Problem gefunden. tWRRD_sg war zu optimistisch und hat sporadisch Fehler geschmissen. Korrigiert und 8266 ist geschmeidig VT3 auch über Stunden fehlerfrei.
Nun hab ich mir gedacht, teste ich mal mein Board und meine Sticks einzeln, da bei mir die CPU limitiert. Ergebnis: im äußeren Slot des Boards kann ich den minimal besseren der beiden DIMMs mit 8800 ins Windows booten. Der andere ging zumindest auf Anhieb ins BIOS, mit 2-3 Versuchen und Spannungen anpassen (ich hab einfach nur ins blaue etwas erhöht) würde der wohl auch die 8800 ins Windows machen. Im inneren Slot des Boards bekomme ich beide DIMMs einzeln mit 8600 ins Windows. Jetzt weiß ich jedenfalls, dass mein Board taugt und die DIMMs super sind.
EDIT: jetzt hab ichs mit beiden DIMMs drin, 1.3 SA, 1.35VDDQTX, 1.45VDDQ und 1.5VDD mit 8600 ins Windows geschafft. Benchbar isses aber Karhu haut zeitnah Fehler raus.
Nun hab ich mir gedacht, teste ich mal mein Board und meine Sticks einzeln, da bei mir die CPU limitiert. Ergebnis: im äußeren Slot des Boards kann ich den minimal besseren der beiden DIMMs mit 8800 ins Windows booten. Der andere ging zumindest auf Anhieb ins BIOS, mit 2-3 Versuchen und Spannungen anpassen (ich hab einfach nur ins blaue etwas erhöht) würde der wohl auch die 8800 ins Windows machen. Im inneren Slot des Boards bekomme ich beide DIMMs einzeln mit 8600 ins Windows. Jetzt weiß ich jedenfalls, dass mein Board taugt und die DIMMs super sind.
EDIT: jetzt hab ichs mit beiden DIMMs drin, 1.3 SA, 1.35VDDQTX, 1.45VDDQ und 1.5VDD mit 8600 ins Windows geschafft. Benchbar isses aber Karhu haut zeitnah Fehler raus.
Zuletzt bearbeitet:
@Darkthrone
hast Du schon mal SA auf 1.15-1.2 probiert?
hast Du schon mal SA auf 1.15-1.2 probiert?
Darkthrone
Profi
For 8000 I need 1.21v to pass VST/VT3. 8200 with less than 1.25 it fails 1st loop.
G40racer79
Enthusiast
ich hab hier nen asus strix z790 gaming H mit einem 12900ks und 2x16GB corsair dominator platinum 7600 cl36 hier.
wollte es gern so hoch wie möglich laufen lassen, ja ich weiß die 7600mhz sind mit dem 12900ks nicht zuschaffen aber so 6600mhz soltten doch drin sein,
aber irgendwie komme ich nicht über 5600mhz hinaus. xmp is geladen und der takt auf erstmal 5600mhz reduziert, das läd er dann auch aber sobald ich eine stufe höher gehen
will möchter er nicht mehr. gibts da ne einstellung die ich übersehen habe ?
wollte es gern so hoch wie möglich laufen lassen, ja ich weiß die 7600mhz sind mit dem 12900ks nicht zuschaffen aber so 6600mhz soltten doch drin sein,
aber irgendwie komme ich nicht über 5600mhz hinaus. xmp is geladen und der takt auf erstmal 5600mhz reduziert, das läd er dann auch aber sobald ich eine stufe höher gehen
will möchter er nicht mehr. gibts da ne einstellung die ich übersehen habe ?
Mit meinem 12900K und dem Z690 Apex waren damals nicht mehr als 6000MT/s drin. Erst mit dem 13900K und Z790 (Apex) waren 7600 MT/s dann plug and play. Wie hoch ist denn der IMC von Deiner CPU? Hast Du das aktuelle Bios drauf? Was sagt denn die QVL des Boards, was da laufen kann/soll?
Batman1982
Experte
- Mitglied seit
- 12.11.2016
- Beiträge
- 292
Abend, also hoffe nicht das ich gesteinigt werde, aber so richtig fündig über die Suche bin ich nicht geworden.
Wollt mich nun auch mal ans Ram optimieren machen beim Intel 14900K auf Asus Dark Hero ( gefiehl mir optisch am besten und 7600 oder 7400 langen mir locker. ( hatte bisher letzten 2 Jahre Amd)
Sobald ich da aber Y-Cruncher starte geht Leistungsaufnahme durch die Decke und Temps halt auch. Wenn ich die meisten Screens hier siehe verbrauchen die meisten 250watt im Peak. Reicht es da wenn ich pl 1/2 zum ram optimieren begrenze oder muss da noch was anderes gemacht werden?
Sorry falls die Frage schon mal war vielleicht werd ich auch nur zu alt für des ganze langsam
Grüsse
Wollt mich nun auch mal ans Ram optimieren machen beim Intel 14900K auf Asus Dark Hero ( gefiehl mir optisch am besten und 7600 oder 7400 langen mir locker. ( hatte bisher letzten 2 Jahre Amd)
Sobald ich da aber Y-Cruncher starte geht Leistungsaufnahme durch die Decke und Temps halt auch. Wenn ich die meisten Screens hier siehe verbrauchen die meisten 250watt im Peak. Reicht es da wenn ich pl 1/2 zum ram optimieren begrenze oder muss da noch was anderes gemacht werden?
Sorry falls die Frage schon mal war vielleicht werd ich auch nur zu alt für des ganze langsam
Grüsse
G40racer79
Enthusiast
Der imc wird glaube erst ab 13000er angezeigt.
Dachte eigentlich da mein 12900ks mit ddr4 locker 4000 gemacht hat mit wenig SA Voltage, dann geht er bestimmt mit ddr5 auch ü6000 locker.
Laut QVL Liste ist der Speicher drin aber nicht mit der 12000er CPU. Taucht erst auf wenn ich 13000er auswähle.
Zuletzt bearbeitet:
Benjamin1990
Urgestein
- Mitglied seit
- 30.11.2008
- Beiträge
- 4.140
@G40racer79
Dein trfc ist viel zu scharf ich habe 550 und vdd/q ist viel zu hoch
Ich habe einen 12900k sp83 und ein z690 strix e und kann 7000 cl34 laufen lassen bei 1,415 vdd/q
Denke du musst deine imc Spannung etwas anheben und Sa Spannung anpassen
Dein trfc ist viel zu scharf ich habe 550 und vdd/q ist viel zu hoch
Ich habe einen 12900k sp83 und ein z690 strix e und kann 7000 cl34 laufen lassen bei 1,415 vdd/q
Denke du musst deine imc Spannung etwas anheben und Sa Spannung anpassen
G40racer79
Enthusiast
Hab schon alles mögliche versucht. SA von 1.15v - 1.275v und imc von 1.25v - 1.375v
Vdd/q hab ich jetzt bei 1.4v und die 5600 gehen grad so. Nicht immer
